Descripción: MAINT FPGA 20K GA VIEWLOGIC SYS
Descripción: INTEGRAPH SCHEM SYNTH/SIM MAINT
Descripción: MAINT EXEMPLAR SYNTHESIS
Descripción: INTEGRAPH SCHEM SYNTH/SIM LIBRA
Descripción: MENTOR V8 LIBRARIES/INTERFACE
Descripción: DESIGN SYS PWRVIEW/SIMUL 20K GAS
Descripción: MAINT 10K VIEWLOGIC UPGRADE
Descripción: MAINT 20K VIEWLOGIC UPGRADE
Descripción: ATMEL SYNARIO BASIC PACKAGE
Descripción: CADENCE LIRARIES/INTRFC MAINT
Descripción: EXEMPLAR SYNTHESIS LIBS/INTRFC
Descripción: ATMEL SYNARIO VHDL SYNTHESIS OPT
Descripción: EXEMPLAR SYNTHESIS LIBS/INTRFC
Descripción: ATMEL SYNARIO VERILOG SIM OPTION
Descripción: SOFTWARE DESIGN PROCHIP
Descripción: MENTOR V8 LIBRARIES/INTRFC MAINT
Descripción: SYNOPSYS LIBRARIES/INTRFC MAINT
Descripción: INTEGRAPH SCHEM SYNTH/SIM LIBRA
Descripción: ATMEL SYNARIO VHDL SYNTHESIS OPT
Descripción: CADENCE VERILOG LIB/INTRFC MAINT
20/05/2025